應(yīng)屆畢業(yè)生
碩士
2025-06-23 16:57:31
50人關(guān)注
職位描述
該職位還未進(jìn)行加V認(rèn)證，請仔細(xì)了解后再進(jìn)行投遞！
工作職責(zé)
1、負(fù)責(zé)仿真平臺的規(guī)劃和方案的編寫
2、負(fù)責(zé)使用SystermVerilog和UVM語言，開發(fā)組件，搭建ut/it/st的驗證環(huán)境
3、負(fù)責(zé)開發(fā)斷言（SVA）和功能覆蓋率
4、負(fù)責(zé)規(guī)劃和開發(fā)測試用例，完成設(shè)計代碼的完備性驗證
5、參與項目組內(nèi)仿真代碼的走查和評審
6、參與并完善公司的芯片驗證流程
任職要求
1、教育背景：碩士及以上，通信、電子、計算機(jī)、微電子等相關(guān)專業(yè)優(yōu)先
2、工作經(jīng)驗：相關(guān)領(lǐng)域5年以上驗證經(jīng)驗
3、具有較好的學(xué)習(xí)能力、溝通能力和團(tuán)隊協(xié)作能力
關(guān)鍵能力要求
1、工作經(jīng)歷：
1）SOC/OTN/PON/MAC/PCS/DSP/PTN相關(guān)設(shè)計經(jīng)驗者優(yōu)先
2）參與過至少一個完整ASIC項目
2、技能要求：
1) 熟悉芯片相關(guān)驗證流程
2) 熟練使用SystermVerilog和UVM語言
3) 熟練使用斷言(SVA)和功能覆蓋率
4）熟練使用vcs/verdi/dve等EDA工具
5) 熟悉linux，至少熟練掌握一門腳本語言(Perl/Python)
注：聯(lián)系我時，請說是在四川人才網(wǎng)上看到的。
工作地點
地址：成都雙流區(qū)成都-雙流區(qū)西博城[地鐵站]
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職位發(fā)布者
HR
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